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저자정보
Nguyen Van Quang (Sungkyunkwan University) Ghayur Hussain (Sungkyunkwan University) Kang-Yoon Lee (Sungkyunkwan University)
저널정보
대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 추계학술대회 논문집
발행연도
2024.11
수록면
90 - 94 (5page)

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This paper presents a dynamic comparator for SAR ADCs that incorporates offset cancellation and minimizes static power consumption. The design uses offset cancellation capacitors to reduce threshold voltage mismatch, mitigating its impact on overdrive voltage. Two PMOS switches, controlled by the latching stage, eliminate static power dissipation in the preamplifier after decision-making. Fabricated in 130nm CMOS technology with a 1.2V supply and 1GHz operating frequency, the comparator achieves a 380.45μV offset voltage and remains stable with input common-mode voltages between 600mV and 800mV, outperforming previous designs.

목차

Abstract
I. Introduction
II. Proposed Comparator
Ⅲ. Simulation Results
Ⅳ. Conclusion
References

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