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대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제41권 제8호
발행연도
2004.8
수록면
679 - 686 (8page)

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이 논문에서는 Interpolation 구조를 이용한 3.3V 8-bit 500MSPS CMOS A/D 변환기를 설계하였다. 고속 동작의 문제를 해결하기 위해서 새로운 프리앰프, 기준 전압 흔들림을 보정하기 위한 회로, 평균화 저항을 제안하였다. 제안된 Interpolation A/D 변환기는 Track & Hold, 256개의 기준전압이 있는 4단 저항열, 128개의 비교기 그리고 디지털 블록으로 구성되어 있다. 제안된 A/D 변환기는 0.35um 2-poly 4-metal N-well CMOS 공정이다. 이 A/D 변환기는 33V 에서 4mW를 소비하며, 유효 칩 면적은 2250um×3080um을 갖는다.

목차

요약

Abstract

1. 서론

2. Interpolation 기법을 이용한 8Bit A/D 변환기의 설계

3. Full Chip 회로도 및 모의실험 결과

4. Chip Implementation 및 측정 결과

5. 결론

참고문헌

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참고문헌 (8)

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UCI(KEPA) : I410-ECN-0101-2009-569-014267631