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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2006.5
- 수록면
- 1 - 10 (10page)
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본 논문에서는, 1.8V 8-bit 500MSPS CMOS A/D 변환기를 제안한다. 8-bit 해상도, 고속의 샘플링과 입력 주파수, 그리고 저 전력을 구현하기 위하여 Cascaded-Folding Cascaded-Interpolation type으로 설계되었다. 또한 본 연구에서는 고속 동작의 문제점들을 해결하기 위하여 새로운 구조의 Digital Encoder, Reference Fluctuation을 보정하기 위한 회로, 비교기 자체의 Offset과 Feedthrough에 의한 오차를 최소화하기 위한 Averaging Resistor, SNR을 향상시키기 위한 Distributed Track & Hold를 설계하여 최종적으로 500MSPS의 A/D 변환기 출력 결과를 얻을 수가 있다. 본 연구에서는 1.8V의 공급전압을 가지는 0.18㎛ 1-poly 5-metal N-well CMOS 공정을 사용하였고, 소비전력은 146mW로 Full Flash 변환기에 비해 낮음을 확인할 수 있었다. 실제 제작된 칩은 측정결과 500MSPS에서 SNDR은 약 43.72dB로 측정되었고, Static상태에서 INL과 DNL은 각각 ±1LSB 로 나타났다. 유효 칩 면적은 1050um × 820um의 면적을 갖는다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 8bit A/D 변환기의 설계
Ⅲ. FULL chip 회로도 및 모의실험 결과
Ⅳ. 레이아웃 및 측정결과
Ⅴ. 결론
참고문헌
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