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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2007.5
- 수록면
- 272 - 275 (4page)
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본 논문에서 1.8V 12-bit 80MSPS CMOS A/D 변환기를 제안하였다. 12-bit의 저 전력 소 면적을 구현하기 위해 Folding Interpolation 구조로 설계하였고, Even Folding 기법을 사용하였다. SNR을 향상시키기 위하여 Cascaded-Folding, Cascaded-Interpolation 기법 및 Distributed track and hold를 사용하였다. 또한 Reference Fluctuation을 감소시키기 위하여 새로운 Encoder를 제안하였다. 사용한 공정은 0.18um 1-poly 4-metal n-well CMOS 이다. 칩의 유효 면적은 2000μm×1100μm이다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 제안하는 A/D 변환기의 설계
Ⅲ. FULL chip 회로도 및 레이아웃
Ⅳ. 결론
감사의 말
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