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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2005.8
- 수록면
- 43 - 52 (10page)
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프리스케일러는 PLL(Phase Locked Loop)의 동작속도를 결정하는 중요한 부분으로서 저전력의 요구조건 또한 만족해야 한다. 따라서 프리스케일러에 적용되는 TSPC(True Single Pulse Clocked) D-플립플롭의 설계가 중요하다. 기존의 TSPC D-플립플롭은 출력단의 글리치(glitch) 문제와 클럭의 프리차지(precharge)구간에서 내부노드의 불필요한 방전으로 인한 소비전력이 증가하는 단점이 있다. 본 논문에서는 프리차지와 방전을 위한 클럭 트랜지스터 패스를 공유함으로서 클럭 트랜지스터의 수를 감소시켰고, 입력 단에 PMOS 트랜지스터를 추가하여 프리차지 구간동안의 불필요한 방전을 차단함으로서 소비전력을 최소화하였다. 또한 출력 단에 NMOS 트랜지스터를 추가함으로서 글리치 문제를 제거했고, 안정적인 동작을 하는 TSPC D-플립플롭을 제안하였다. 제안된 D-플립플롭을 프리스케일러에 적용시켜 검증한 결과 3.3V에서의 최대동작주파수는 2.92㎓, 소비전력은 10.61㎽로 기존의 회로와 비교하였을 때 PDP(Power-Delay-Product) 측면에서 45.4%의 개선된 결과를 얻었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 프리스케일러와 TSPC D-플립플롭
Ⅲ. 기존의 TSPC D-플립플롭
Ⅳ. 제안한 TSPC D-플립플롭 및 동작원리
Ⅴ. 모의실험 결과
Ⅵ. 결론
참고문헌
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[학술지(정기간행물)] - Yuan.J / feb.1989. / High-speed CMOS circuit technique 24 : 62 ~ 70
[학술지(정기간행물)] - 허준호 / 2002.12. / 안정적인 고속동작을 위한 다이내믹 D Flip-Flop : 1055 ~ 1061
[학술지(정기간행물)] - Byungsoo Chang / May.1996. / A 1.2 GHz CMOS dual-modulus prescaler using new dynamic D-type flip-flops 31 : 749 ~ 752
[학술지(정기간행물)] - Rogenmoser.R / May.1994. / 1.57 GHz asynchronous and 1.4 GHz dual-modulus 1.2 m CMOS prescalers : 387 ~ 390
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