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대한전자공학회 전자공학회논문지-SD 전자공학회논문지 SD편 제42권 제10호
발행연도
2005.10
수록면
55 - 64 (10page)

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본 논문에서는 실시간 3D 가속을 효과적으로 하기 위해 기하학 처리 과정에 적합한 부동 소수점 연산기를 설계하였다. 설계한 부동 소수점 연산기는 IEEE-754 단정도 형식을 지원하도록 하여 기하학 처리에 적합하게 하였고 설계한 부동 소수점 연산기는 Xilinx-Vertex2에서 부동소수점 덧셈/곱셈기는 100㎒, 부동소수점 NR 역수 계산기는 120㎒, 부동 소수점 멱승기는 200㎒, 부동 소수점 역 제곱근 연산기는 120㎒의 동작 주파수를 각각 확인 하였다. 또한 설계된 부동소수점 연산기를 이용해 실제 기하학 프로세서를 구현하여 실제 3D 데이터 처리를 확인하였다.

목차

요약

Abstract

Ⅰ. 서론

Ⅱ. 기하학 처리 과정에 필요한 부동소수점 연산

Ⅲ. 부동소수점 연산기 설계

Ⅳ. 실험 결과 및 성능 측정

Ⅴ. 결론

참고문헌

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