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대한전자공학회 전자공학회논문지-IE 전자공학회논문지 IE편 제43권 제3호
발행연도
2006.9
수록면
6 - 12 (7page)

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이 논문의 연구 히스토리 (2)

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이 논문은 100㎒ 수준의 고속 신호 샘플링을 위해 글리치 최소화 기법을 적용한 8비트 100㎒ CMOS D/A 변환기(Digital to Analog Converter : DAC) 회로를 제안한다. 제안하는 DAC는 0.35 ㎛ Hynix CMOS 공정을 사용하여 설계 및 레이아웃을 하였으며, 응용되는 시스템의 속도, 해상도 및 면적 등의 사양을 고려하여 전류 모드 구조로 적용되었다. D/A 변환기의 선형 특성은 설계한 Spec. 과 유사하였으며, ± 0.09LSB 정도의 DNL과 INL오차가 측정되었다. 제작된 칩 테스트 결과에 대한 오동작의 원인을 분석하였으며, 이를 통하여 칩 테스트를 위한 고려사항 등을 제안하였다.

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 본론
Ⅲ. 결론
참고문헌
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