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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2010.5
- 수록면
- 504 - 512 (9page)
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본 논문에서는 무선 USB 칩-셋 내 무선통신시스템단에 적용될 수 있는 6비트 800MS/s 플래쉬 A/D 변환기를 설계하였다. 기존의 A/D 변환기에서 서로 독립적으로 사용되던 오차보정회로단과 동기화단을 하나의 회로로 간소화 시켜서, 하드웨어에 대한 부담을 감소시켰다. 제안한 오차보정회로는 기존의 오차보정회로보다 MOS 트랜지스터의 수를 5개 감소시킬 수 있으며, 오차보정회로 한 개당 면적은 9% 정도 감소하게 된다. 설계된 A/D 변환기는 0.18㎛ CMOS 1-poly 6-metal 공정으로 제작되었으며 측정 결과 입력 범위 0.8Vpp, 1.8V의 전원 전압에서 182㎽의 전력 소모를 나타내었다. 800MS/s의 변환속도와 128.1㎒의 입력주파수에서 4.0비트의 ENOB을 나타내었다.
목차
요약
ABSTRACT
Ⅰ. 서론
Ⅱ. 제안한 6비트 A/D 변환기의 설계
Ⅲ. 6비트 A/D 변환기 레이아웃
Ⅳ. 측정 결과 및 고찰
Ⅴ. 결론
참고문헌
참고문헌 (16)
참고문헌 신청
1. [학술대회논문] - Brad Hosler / 2007 / Certified Wireless USB / Certified WIreless USB Developers Conference
2. [학술지(정기간행물)] - Lalitkumar Y. Nathawad / 2003 / 40-GHz-Bandwidth, 4-bit, Time-Interleaved A/D Converter Using Photoconductive Sampling / IEEE J. Solid-State Circuits 38 : 2021 ~ 2030
3. [학술지(정기간행물)] - Pedro M. Figueiredo / 2006 / Kickback Noise Reduction Technique forCMOS Latched Comparator / IEEE Tran.Circuit Syst. Ⅱ 53 (7)
4. [단행본] - B.Razavi / 1995 / Principles of Data Conversion System Design / IEEE Press
5. [학술지(정기간행물)] - Jeny (Heng-Chih) Lin / 2002 / An Embedded 0.8V/480uW 6B/22MHz FlashADC in 0.13-um Digital CMOS Process Using a Nonlinear Double Interpolation Technique / IEEE J. Solid-State Circuits 38 : 1610 ~ 1617
2. [학술지(정기간행물)] - Lalitkumar Y. Nathawad / 2003 / 40-GHz-Bandwidth, 4-bit, Time-Interleaved A/D Converter Using Photoconductive Sampling / IEEE J. Solid-State Circuits 38 : 2021 ~ 2030
3. [학술지(정기간행물)] - Pedro M. Figueiredo / 2006 / Kickback Noise Reduction Technique forCMOS Latched Comparator / IEEE Tran.Circuit Syst. Ⅱ 53 (7)
4. [단행본] - B.Razavi / 1995 / Principles of Data Conversion System Design / IEEE Press
5. [학술지(정기간행물)] - Jeny (Heng-Chih) Lin / 2002 / An Embedded 0.8V/480uW 6B/22MHz FlashADC in 0.13-um Digital CMOS Process Using a Nonlinear Double Interpolation Technique / IEEE J. Solid-State Circuits 38 : 1610 ~ 1617
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