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넓은 범위의 DLL을 위한 버터플라이 형태의 단위 지연 셀
대한전자공학회 학술대회
2007 .07
넓은 범위의 DLL을 위한 버터플라이 형태의 단위 지연 셀
대한전자공학회 학술대회
2007 .07
Delay Monitor Scheme을 사용한 Register Controlled Delay-locked Loop
전기전자재료학회논문지
2004 .01
저전력과 고속 록킹 알고리즘을 갖는 DLL ( Delay-Locked Loop ) 설계 ( A Design of DLL ( Delay-Locked-Loop ) with Low Power & High Speed locking Algorithm )
한국통신학회논문지
2001 .12
새로운 Locking 알고리즘을 이용한 DLL(Delay - Locked - Loop) 설계
대한전자공학회 학술대회
2000 .11
Design of Delay-Locked Loop for Wide Frequency Locking Range
대한전자공학회 ISOCC
2013 .11
A Digital DLL with 4-Cycle Lock Time and 1/4 NAND-Delay Accuracy
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2016 .08
CMOS 0.18um 공정을 이용한 광범위, 저전력 Delay-Locked Loop의 설계
대한전자공학회 학술대회
2015 .06
위상지연을 이용한 Integer-N 방식의 위상ㆍ지연고정루프 설계
전자공학회논문지-SD
2010 .06
A Delay Locked Loop with an Embedded Duty Cycle Corrector
ITC-CSCC :International Technical Conference on Circuits Systems, Computers and Communications
2015 .06
Delay Locked Loop Design Issues
대한전자공학회 ISOCC
2004 .10
A High-Resolution Dual-Loop Digital DLL
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2016 .08
An All-digital Delay-locked Loop using a Lock-in Pre-search Algorithm for High-speed DRAMs
JOURNAL OF SEMICONDUCTOR TECHNOLOGY AND SCIENCE
2017 .12
n - Δ delay-Lock Loops의 성능 해석 ( Performance Analysis of Extended n - Δ Delay-Lock Loops )
전자공학회지
1981 .02
A Delay-Locked Loop ( DLL ) for On-Chip Clock Driver
대한전자공학회 학술대회
1998 .01
Design of Low Power 1.8V, Wide Range 50~500MHZ Delay Locked Loop
대한전자공학회 기타 간행물
2001 .11
광대역 아날로그 이중 루프 Delay-Locked Loop
전자공학회논문지-SC
2007 .01
이중루프 위상ㆍ지연고정루프 설계
한국정보통신학회논문지
2011 .07
전력선 통신을 위한 디지털 DLL 개발 ( Digital Delay Lock Loop Development for Power Line Communication )
대한전자공학회 학술대회
1997 .01
PERFORMANCE ANALYSIS OF EXTENDED N-Δ DELAY-LOCK LOOPS
대한전자공학회 심포지엄 논문집
1980 .01
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