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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2005.10
- 수록면
- 401 - 404 (4page)
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목차
Abstract
1 Introduction
2 Top Block Architectu
3 8B/10B Encoder
4 Phase Locked Loop
5 10 :1 MUX and 1 :10 DEMUX
6 Clock & Data Recovery
7 Simulation and Implemention
8 Conclusion
Acknowledgment
References
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