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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2017.6
- 수록면
- 236 - 239 (4page)
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In this paper, a fast locking phase locked loop (PLL) using switched capacitor is mathematically analyzed. The schemes analyzed in this paper effectively suppresses the phase noise of ring oscillator, enabling the use of ring oscillator. Type-I loop filter, which enables PLL to widen bandwidth, and techniques to reduce spur level are major topics discussed in the paper.
목차
Abstract
I. 서론
II. 회로 구성
III. 회로의 수식적 분석
IV. 결론
참고문헌
참고문헌 (0)
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