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학술대회자료
저자정보
이주연 (성균관대학교) 김소영 (성균관대학교)
저널정보
대한전자공학회 대한전자공학회 학술대회 2024년도 대한전자공학회 하계학술대회 논문집
발행연도
2024.6
수록면
736 - 739 (4page)

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This paper developed a PDK for SWCNT-based printed TFTs, including a device layout library, design rule checking (DRC), layout versus schematic (LVS), and an incremental technology (ICT) file for layout parasitic extraction (LPE). First, we conducted transmission gate flip-flop (TGFF) schematic simulations using Cadence"s Virtuoso to verify the desired functionality, then designed the TGFF layout using the developed PDK. Subsequently, DRC and LVS were performed using Assura, and LPE using Quantus, to ensure compliance with design rules and consistency between schematics and layouts, achieving optimization of the layout design. This process ensured the reliability and optimization of the layout design, providing a practical application case of circuit design using printed devices.

목차

Abstract
Ⅰ. 서론
Ⅱ. Device layout library 구축
Ⅲ. Rule 개발
Ⅳ. 시뮬레이션 결과
Ⅴ. 결론
참고문헌

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