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논문 기본 정보
- 자료유형
- 학술저널
- 저자정보
- 발행연도
- 2004.12
- 수록면
- 17 - 22 (6page)
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본 논문에서는 HDD 나 LAN 등에 응용하기 위한 VLSI 의 내장회로로 사용하기에 적합한 CMOS 6 비트 2단 폴딩 AD 변환기를 설계하였다. AD 변환기의 소비전력과 칩 면적을 줄이기 위하여 폴딩이 2 번 반복되는 2 단 구조를 사용하였다. 두번째 단에 사용하는 폴딩 회로로서 트랜지스터 차동쌍을 이용한다. 제안한 트랜지스터 차동쌍을 이용한 폴딩 AD 변환기는 디지털 출력을 얻기 위한 전압비교기의 개수를 현저히 줄이고 인터폴레이팅을 위한 사다리 저항을 사용하지 않으므로 소비전력과 챔 연적이 작아 내장회로의 응용에 많은 장점을 제공한다. 또한 폴딩 증폭기는 입력전압의 전 범위에서 완전 차동산호를 출력 하도록 설계하여 비선형 동작특성이 현저히 개선된다. 제조 공정 기술은 0.25um double-poly 2 metal n-well CMOS 공정을 사용하였다. 모의실험결과 25V 전원전압을 인가하고 500 MHz 의 샘플링 주파수에서 32mW 의 전력을 소비하였으며 INL 과 DNL 은 각각 ±0.1LSB, SNDR 은 10MHz 입력신호에서 42dB 로 측정되었다.
목차
요약
Abstract
Ⅰ. 서론
Ⅱ. 2 단 폴딩 ADC의 구조
Ⅲ. 트랜지스터 차동쌍 폴더의 동작원리
Ⅳ. 모의실험
Ⅴ. 결론
참고문헌
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[학술지(정기간행물)] - / .1984.06 / A Monolithic 8-Bit Video A/D Converter sc-19 (3) : 376 ~ 377
[학술지(정기간행물)] - / / IEEE J. of Solid-State Circuits sc-22 : 994 ~ 953
[학술지(정기간행물)] - / 1997. / A 12b 50MSamples/s Cascaded Folding and Interpolating ADC : 134 ~ 135
[학술지(정기간행물)] - / 1998. / A 400-Msample/s, 6-b CMOS folding ADC : 1932 ~ 1938
[학술지(정기간행물)] - / Dec.1998 / 400-M sample/s, 6-b CMOS Folding and Interpolating ADC 33 (12) : 1932 ~ 1938
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