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논문 기본 정보
- 자료유형
- 학술대회자료
- 저자정보
- 발행연도
- 2008.11
- 수록면
- 536 - 539 (4page)
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This paper proposes effective 3D graphics hardware. It is designed to support the OpenGL ES 2.0 and Shader model 3.0. We develop all module (vertex shader, clipping engine, triangle setup engine, rasterizer, pixel shader and raster operator) of 3D pipeline on FPGA using RTL design. The proposed hardware of which total gate count is about 1.486M operates with 100Mpixels/sec at pixel shader. Compared to the other product of a company, the proposed architecture result in about 50% improvement in term of cycle.
목차
Abstract
Ⅰ. INTRODUCTION
Ⅱ. THE PROPOSED SYSTEM ARCHITECTURE.
Ⅲ. SIMULATION AND SYNTHESIS
Ⅳ. VERIFICATION AND RESULT
Ⅴ. CONCULUSION
REFERENCES
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