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논문 기본 정보

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대한전자공학회 전자공학회논문지-SD 電子工學會論文誌 SD編 第45卷 第9號
발행연도
2008.9
수록면
85 - 95 (11page)

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3D 그래픽 알고리즘은 특성상 방대한 양의 스트림 데이터에 대하여 복잡한 연산을 수행하여야 한다. 이러한 알고리즘을 하드웨어에서 신속하게 수행할 수 있는 버텍스 셰이더와 픽셀 셰이더의 도입으로 그래픽 프로세서는 “소프트웨어 셰이더의 하드웨어화”라는 목표를 어느 정도 달성한 것처럼 보이지만, 여전히 Z-버퍼 기반이라는 특정 알고리즘의 틀에서 벗어나지 못하고 있다. 향후 그래픽 프로세서가 궁극적으로 추구하는 모델은 알고리즘에 독립적인 그리고 버텍스 셰이더와 픽셀 셰이더가 통합된 셰이더로 발전할 것이다. 본 논문에서는 프로그래머블 통합 셰이더 프로세서에서 고성능 3차원 컴퓨터 그래픽 영상을 지원하기 위한 멀티포트 레지스터 파일 모델을 설계하고 구현하였다. 설계한 멀티포트 레지스터 파일을 기능적 레벨에서 시뮬레이션을 하여 그 성능을 검증 하였으며, FPGA Virtex-4(xc4vlx200)에 직접 구현하여 하드웨어 리소스 사용율과 속도를 확인 하였다.
#Graphic processor #Register file #shader processor #HDL #FPGA

목차

요약
Abstract
Ⅰ. 서론
Ⅱ. 관련 연구
Ⅲ. SIMD 프로그래머블 셰이더 프로세서 구조 및 레지스터 파일 모델
Ⅳ. SIMD 프로그래머블 셰이더 프로세서를 위한 레지스터 파일의 설계
Ⅴ. 로직 합성 및 설계 검증
Ⅵ. 결론 및 향후 연구 과제
참고문헌
저자소개

참고문헌 (15)

참고문헌 신청
1. [학술대회논문] - T. Mitra / 1999 / Dynamic 3D Graphics Workload Characterization and the Architectural Implications / In MICRO International Symposium on Microar-chitecture google schola 2. [학위논문] - W. K. Jeong / 2002 / A SIMD-DSP/FPU for High- Performance Embedded Microprocessors / Phd / Yonsei University google schola 3. [학위논문] - Cheol-Ho Jeong / 1998 / The Design of Geometry Processor for 3D Graphics / Master / Yonsei University google schola 4. [단행본] - J. H. Sohn / 2004 / A Programmable Vertex Shader with Fixed-point SIMD Data Path for Low Power Wireless / Applications. Graphics Hardware google schola 5. [학술지(정기간행물)] - D. Kim / 2006 / An SoC with 1.3Gtexels/s 3-D Graphics Full Pipeline for Consumer plications / IEEE Journal of Solid State Circuits 40 (1) google schola

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