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저널정보
한국전기전자학회 전기전자학회논문지 전기전자학회논문지 제14권 제1호
발행연도
2010.4
수록면
65 - 74 (10page)

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이 논문의 연구 히스토리 (4)

2011

DTV 튜너를 위한 48MHz~1675MHz 주파수합성기 설계
고승오 ,  서희택 ,  권덕기 외 1명 한국정보통신학회논문지 2011.05 학술저널

2010

DTV 튜너를 위한 CMOS Fractional-N 주파수합성기
고승오 ,  서희택 ,  박종태 외 1명 전기전자학회논문지 2010.04 학술저널

2009

DTV 튜너를 위한 48㎒~1675㎒ 주파수합성기 설계
고승오 ,  서희택 ,  박종태 외 1명 대한전자공학회 학술대회 2009.11 학술대회자료
DTV 응용을 위한 광대역 CMOS 주파수합성기 설계
고승오 ,  이덕환 ,  박종태 외 1명 대한전자공학회 학술대회 2009.05 학술대회자료

초록· 키워드

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최근 TV 방송의 새로운 시장인 DTV 시장이 넓어지면서 DTV 튜너에 대한 요구도 많아지고 있다. DTV 튜너를 설계하는 데에는 많은 어려운 부분이 있지만, 가장 어려운 부분 중에 하나가 주파수합성기이다. 본 논문에서는 DTV 튜너를 위한 주파수합성기 회로를 CMOS 공정을 사용하여 설계하였다. 설계한 주파수합성기는 DTV(ATSC)의 주파수 대역(54~806MHz)을 만족한다. 하나의 VCO를 사용하여 광대역을 만족시킬 수 있는 구조를 제안하고, LO pulling 효과를 최소화 하기위하여 1.6~3.6GHz 대역에서 동작하도록 설계하였다. 또한 고주파 대역과 저주파 대역에서의 VCO 이득의 차이와 주파수 간격의 변화를 줄여 안정적인 광대역 특성을 구현하였다. 모의실험 결과, 설계한 VCO의 이득은 59~94MHz(17.7MHz/V,23%)이고, 주파수 간격은 26~42.5MHz (8.25MHz/V,24%)이며, tuning range는 76.9%이다. 설계된 주파수합성기의 위상잡음은 100kHz offset에서 -106dBc/Hz이고, 고착시간은 약 정도이다. 설계된 회로는 1.8V 전원전압에서 20~23mA의 전류를 소모하며 칩 면적은 PAD를 포함하여 2.0mm×1.8mm이다.
#DTV #Fractional-N #Frequency Synthesizer #LC VCO

목차

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참고문헌 (15)

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1. [기타자료] - United States Advanced Television Systems Committee / 1995 / / ATSC Digital Television Standard, September google schola 2. [학술지(정기간행물)] - Supisa Lerstaveesin / 2008 / A 48-860MHz CMOS Low-IF Direct-Conversion DTV Tuner / IEEE J.Solid-State Circuit 43 (9) : 2013 ~ 2024 google schola 3. [기타자료] - J.Xiao / 2007 / Low-Power Fully Integrated CMOS DTV Tuner Front-End for ATSC Terrestrial Broadcasting / VLSI Design,Article ID 71974 google schola 4. [기타자료] - J.van Sinderen / 2003 / A 48-860MHz digital cable tuner IC with integrated RF and IF selectivity / ISSCC Dig.Tech.Papers : 444 ~ 506 google schola 5. [학술지(정기간행물)] - 문제철 / 2008 / Mobile-DTV 응용을 위한 광대역 주파수 합성기의 설계 / 전자공학회논문지 - SD 45 (5) : 40 ~ 49 dbpia

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